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FPGA开发工程师

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Verilog VHDL

工作地点

南京

职位描述

  1. 低延迟FPGA应用开发的完整流程（设计、文档、开发、测试）

任职要求

  1. 统招大学本科及以上学历，计算机专业、电子、软件工程、通信、电气自动化等相关专业；
  2. 熟悉Verilog/VHDL；
  3. 2年及以上工作经验，应届研究生有项目经验也可；
  4. 有如下经验之一者优先：Systemverilog, TCP/IP, DDR, PCle, Linux驱动, 高频交易, C。

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